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Quartus II 32-bit Version 13.0.1 Build 232 06/12/2013 Service Pack 1 SJ Web Edition
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; Table of Contents ;
---------------------
1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Parallel Compilation
5. Fitter Netlist Optimizations
6. Ignored Assignments
7. Incremental Compilation Preservation Summary
8. Incremental Compilation Partition Settings
9. Incremental Compilation Placement Preservation
10. Pin-Out File
11. Fitter Resource Usage Summary
12. Fitter Partition Statistics
13. Input Pins
14. Output Pins
15. Bidir Pins
16. I/O Bank Usage
17. All Package Pins
18. PLL Summary
19. PLL Usage
20. Output Pin Default Load For Reported TCO
21. Fitter Resource Utilization by Entity
22. Delay Chain Summary
23. Pad To Core Delay Chain Fanout
24. Control Signals
25. Global & Other Fast Signals
26. Non-Global High Fan-Out Signals
27. Fitter RAM Summary
28. Other Routing Usage Summary
29. LAB Logic Elements
30. LAB-wide Signals
31. LAB Signals Sourced
32. LAB Signals Sourced Out
33. LAB Distinct Inputs
34. Fitter Device Options
35. Operating Settings and Conditions
36. Fitter Messages
37. Fitter Suppressed Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2013 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
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Subscription Agreement, Altera MegaCore Function License
Agreement, or other applicable license agreement, including,
without limitation, that your use is for the sole purpose of
programming logic devices manufactured by Altera and sold by
Altera or its authorized distributors. Please refer to the
applicable agreement for further details.
+--------------------------------------------------------------------------------------+
; Fitter Summary ;
+------------------------------------+-------------------------------------------------+
; Fitter Status ; Successful - Fri Jun 2 10:39:50 2017 ;
; Quartus II 32-bit Version ; 13.0.1 Build 232 06/12/2013 SP 1 SJ Web Edition ;
; Revision Name ; vr ;
; Top-level Entity Name ; vr ;
; Family ; Cyclone II ;
; Device ; EP2C35F672C6 ;
; Timing Models ; Final ;
; Total logic elements ; 2,482 / 33,216 ( 7 % ) ;
; Total combinational functions ; 2,361 / 33,216 ( 7 % ) ;
; Dedicated logic registers ; 1,213 / 33,216 ( 4 % ) ;
; Total registers ; 1279 ;
; Total pins ; 159 / 475 ( 33 % ) ;
; Total virtual pins ; 0 ;
; Total memory bits ; 87,040 / 483,840 ( 18 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; Total PLLs ; 1 / 4 ( 25 % ) ;
+------------------------------------+-------------------------------------------------+
+----------------------------------------------------------------------------------------------------------------------------------+
; Fitter Settings ;
+----------------------------------------------------------------------------+--------------------+--------------------------------+
; Option ; Setting ; Default Value ;
+----------------------------------------------------------------------------+--------------------+--------------------------------+
; Device ; EP2C35F672C6 ; ;
; Use smart compilation ; On ; Off ;
; Maximum processors allowed for parallel compilation ; 4 ; ;
; Fit Attempts to Skip ; 0 ; 0.0 ;
; Optimize Hold Timing ; All Paths ; IO Paths and Minimum TPD Paths ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On ; On ;
; Enable compact report table ; Off ; Off ;
; Auto Merge PLLs ; On ; On ;
; Ignore PLL Mode When Merging PLLs ; Off ; Off ;
; Router Timing Optimization Level ; Normal ; Normal ;
; Placement Effort Multiplier ; 1.0 ; 1.0 ;
; Router Effort Multiplier ; 1.0 ; 1.0 ;
; Always Enable Input Buffers ; Off ; Off ;
; Optimize Multi-Corner Timing ; On ; On ;
; PowerPlay Power Optimization ; Normal compilation ; Normal compilation ;
; Optimize Timing ; Normal compilation ; Normal compilation ;
; Optimize Timing for ECOs ; Off ; Off ;
; Regenerate full fit report during ECO compiles ; Off ; Off ;
; Optimize IOC Register Placement for Timing ; Normal ; Normal ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Delay Chains for High Fanout Input Pins ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic for Fitting ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic for Performance ; Off ; Off ;
; Perform Register Duplication for Performance ; Off ; Off ;
; Perform Logic to Memory Mapping for Fitting ; Off ; Off ;
; Perform Register Retiming for Performance ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Force Fitter to Avoid Periphery Placement Warnings ; Off ; Off ;
+----------------------------------------------------------------------------+--------------------+--------------------------------+
Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation ;
+----------------------------+--------+
; Processors ; Number ;
+----------------------------+--------+
; Number detected on machine ; 4 ;
; Maximum allowed ; 1 ;
+----------------------------+--------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Netlist Optimizations ;
+----------------------------+-----------------+------------------+----------------------------------------+-----------+----------------+-----------------------------------+------------------+-----------------------+
; Node ; Action ; Operation ; Reason ; Node Port ; Node Port Name ; Destination Node ; Destination Port ; Destination Port Name ;
+----------------------------+-----------------+------------------+----------------------------------------+-----------+----------------+-----------------------------------+------------------+-----------------------+
; sdram:ram|m_addr[0] ; Packed Register ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; DRAM_ADDR[0] ; DATAIN ; ;
; sdram:ram|m_addr[0] ; Duplicated ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; sdram:ram|m_addr[0]~_Duplicate_1 ; REGOUT ; ;
; sdram:ram|m_addr[1] ; Packed Register ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; DRAM_ADDR[1] ; DATAIN ; ;
; sdram:ram|m_addr[1] ; Duplicated ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; sdram:ram|m_addr[1]~_Duplicate_1 ; REGOUT ; ;
; sdram:ram|m_addr[2] ; Packed Register ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; DRAM_ADDR[2] ; DATAIN ; ;
; sdram:ram|m_addr[2] ; Duplicated ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; sdram:ram|m_addr[2]~_Duplicate_1 ; REGOUT ; ;
; sdram:ram|m_addr[3] ; Packed Register ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; DRAM_ADDR[3] ; DATAIN ; ;
; sdram:ram|m_addr[3] ; Duplicated ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; sdram:ram|m_addr[3]~_Duplicate_1 ; REGOUT ; ;
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; sdram:ram|m_data[13] ; Packed Register ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; DRAM_DQ[13] ; DATAIN ; ;
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; sdram:ram|m_data[15] ; Packed Register ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; DRAM_DQ[15] ; DATAIN ; ;
; sdram:ram|m_data[15] ; Duplicated ; Register Packing ; Fast Output Register assignment ; REGOUT ; ; sdram:ram|m_data[15]~_Duplicate_1 ; REGOUT ; ;
; sdram:ram|oe ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[0] ; OE ; ;
; sdram:ram|oe ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_1 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_1 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[1] ; OE ; ;
; sdram:ram|oe~_Duplicate_1 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_2 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_2 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[2] ; OE ; ;
; sdram:ram|oe~_Duplicate_2 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_3 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_3 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[3] ; OE ; ;
; sdram:ram|oe~_Duplicate_3 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_4 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_4 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[4] ; OE ; ;
; sdram:ram|oe~_Duplicate_4 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_5 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_5 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[5] ; OE ; ;
; sdram:ram|oe~_Duplicate_5 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_6 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_6 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[6] ; OE ; ;
; sdram:ram|oe~_Duplicate_6 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_7 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_7 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[7] ; OE ; ;
; sdram:ram|oe~_Duplicate_7 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_8 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_8 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[8] ; OE ; ;
; sdram:ram|oe~_Duplicate_8 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_9 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_9 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[9] ; OE ; ;
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; sdram:ram|oe~_Duplicate_10 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[10] ; OE ; ;
; sdram:ram|oe~_Duplicate_10 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_11 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_11 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[11] ; OE ; ;
; sdram:ram|oe~_Duplicate_11 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_12 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_12 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[12] ; OE ; ;
; sdram:ram|oe~_Duplicate_12 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_13 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_13 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[13] ; OE ; ;
; sdram:ram|oe~_Duplicate_13 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_14 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_14 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[14] ; OE ; ;
; sdram:ram|oe~_Duplicate_14 ; Duplicated ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; sdram:ram|oe~_Duplicate_15 ; REGOUT ; ;
; sdram:ram|oe~_Duplicate_15 ; Packed Register ; Register Packing ; Fast Output Enable Register assignment ; REGOUT ; ; DRAM_DQ[15] ; OE ; ;
; sdram:ram|za_data[0] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[0] ; COMBOUT ; ;
; sdram:ram|za_data[1] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[1] ; COMBOUT ; ;
; sdram:ram|za_data[2] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[2] ; COMBOUT ; ;
; sdram:ram|za_data[3] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[3] ; COMBOUT ; ;
; sdram:ram|za_data[4] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[4] ; COMBOUT ; ;
; sdram:ram|za_data[5] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[5] ; COMBOUT ; ;
; sdram:ram|za_data[6] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[6] ; COMBOUT ; ;
; sdram:ram|za_data[7] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[7] ; COMBOUT ; ;
; sdram:ram|za_data[8] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[8] ; COMBOUT ; ;
; sdram:ram|za_data[9] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[9] ; COMBOUT ; ;
; sdram:ram|za_data[10] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[10] ; COMBOUT ; ;
; sdram:ram|za_data[11] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[11] ; COMBOUT ; ;
; sdram:ram|za_data[12] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[12] ; COMBOUT ; ;
; sdram:ram|za_data[13] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[13] ; COMBOUT ; ;
; sdram:ram|za_data[14] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[14] ; COMBOUT ; ;
; sdram:ram|za_data[15] ; Packed Register ; Register Packing ; Fast Input Register assignment ; REGOUT ; ; DRAM_DQ[15] ; COMBOUT ; ;
+----------------------------+-----------------+------------------+----------------------------------------+-----------+----------------+-----------------------------------+------------------+-----------------------+
+-----------------------------------------------------------------------------------------------------------------------------+
; Ignored Assignments ;
+-----------------------------+----------------+--------------+------------------+---------------+----------------------------+
; Name ; Ignored Entity ; Ignored From ; Ignored To ; Ignored Value ; Ignored Source ;
+-----------------------------+----------------+--------------+------------------+---------------+----------------------------+
; Location ; ; ; CLOCK_27 ; PIN_D13 ; QSF Assignment ;
; Location ; ; ; ENET_CLK ; PIN_B24 ; QSF Assignment ;
; Location ; ; ; ENET_CMD ; PIN_A21 ; QSF Assignment ;
; Location ; ; ; ENET_CS_N ; PIN_A23 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[0] ; PIN_D17 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[10] ; PIN_C19 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[11] ; PIN_D19 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[12] ; PIN_B19 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[13] ; PIN_A19 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[14] ; PIN_E18 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[15] ; PIN_D18 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[1] ; PIN_C17 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[2] ; PIN_B18 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[3] ; PIN_A18 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[4] ; PIN_B17 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[5] ; PIN_A17 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[6] ; PIN_B16 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[7] ; PIN_B15 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[8] ; PIN_B20 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[9] ; PIN_A20 ; QSF Assignment ;
; Location ; ; ; ENET_INT ; PIN_B21 ; QSF Assignment ;
; Location ; ; ; ENET_RD_N ; PIN_A22 ; QSF Assignment ;
; Location ; ; ; ENET_RST_N ; PIN_B23 ; QSF Assignment ;
; Location ; ; ; ENET_WR_N ; PIN_B22 ; QSF Assignment ;
; Location ; ; ; EXT_CLOCK ; PIN_P26 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[0] ; PIN_AC18 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[10] ; PIN_AE17 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[11] ; PIN_AF17 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[12] ; PIN_W16 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[13] ; PIN_W15 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[14] ; PIN_AC16 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[15] ; PIN_AD16 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[16] ; PIN_AE16 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[17] ; PIN_AC15 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[18] ; PIN_AB15 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[19] ; PIN_AA15 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[1] ; PIN_AB18 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[20] ; PIN_Y15 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[21] ; PIN_Y14 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[2] ; PIN_AE19 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[3] ; PIN_AF19 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[4] ; PIN_AE18 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[5] ; PIN_AF18 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[6] ; PIN_Y16 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[7] ; PIN_AA16 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[8] ; PIN_AD17 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[9] ; PIN_AC17 ; QSF Assignment ;
; Location ; ; ; FL_CE_N ; PIN_V17 ; QSF Assignment ;
; Location ; ; ; FL_DQ[0] ; PIN_AD19 ; QSF Assignment ;
; Location ; ; ; FL_DQ[1] ; PIN_AC19 ; QSF Assignment ;
; Location ; ; ; FL_DQ[2] ; PIN_AF20 ; QSF Assignment ;
; Location ; ; ; FL_DQ[3] ; PIN_AE20 ; QSF Assignment ;
; Location ; ; ; FL_DQ[4] ; PIN_AB20 ; QSF Assignment ;
; Location ; ; ; FL_DQ[5] ; PIN_AC20 ; QSF Assignment ;
; Location ; ; ; FL_DQ[6] ; PIN_AF21 ; QSF Assignment ;
; Location ; ; ; FL_DQ[7] ; PIN_AE21 ; QSF Assignment ;
; Location ; ; ; FL_OE_N ; PIN_W17 ; QSF Assignment ;
; Location ; ; ; FL_RST_N ; PIN_AA18 ; QSF Assignment ;
; Location ; ; ; FL_WE_N ; PIN_AA17 ; QSF Assignment ;
; Location ; ; ; GPIO_0[0] ; PIN_D25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[10] ; PIN_N18 ; QSF Assignment ;
; Location ; ; ; GPIO_0[11] ; PIN_P18 ; QSF Assignment ;
; Location ; ; ; GPIO_0[12] ; PIN_G23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[13] ; PIN_G24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[14] ; PIN_K22 ; QSF Assignment ;
; Location ; ; ; GPIO_0[15] ; PIN_G25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[16] ; PIN_H23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[17] ; PIN_H24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[18] ; PIN_J23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[19] ; PIN_J24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[1] ; PIN_J22 ; QSF Assignment ;
; Location ; ; ; GPIO_0[20] ; PIN_H25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[21] ; PIN_H26 ; QSF Assignment ;
; Location ; ; ; GPIO_0[22] ; PIN_H19 ; QSF Assignment ;
; Location ; ; ; GPIO_0[23] ; PIN_K18 ; QSF Assignment ;
; Location ; ; ; GPIO_0[24] ; PIN_K19 ; QSF Assignment ;
; Location ; ; ; GPIO_0[25] ; PIN_K21 ; QSF Assignment ;
; Location ; ; ; GPIO_0[26] ; PIN_K23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[27] ; PIN_K24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[28] ; PIN_L21 ; QSF Assignment ;
; Location ; ; ; GPIO_0[29] ; PIN_L20 ; QSF Assignment ;
; Location ; ; ; GPIO_0[2] ; PIN_E26 ; QSF Assignment ;
; Location ; ; ; GPIO_0[30] ; PIN_J25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[31] ; PIN_J26 ; QSF Assignment ;
; Location ; ; ; GPIO_0[32] ; PIN_L23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[33] ; PIN_L24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[34] ; PIN_L25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[35] ; PIN_L19 ; QSF Assignment ;
; Location ; ; ; GPIO_0[3] ; PIN_E25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[4] ; PIN_F24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[5] ; PIN_F23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[6] ; PIN_J21 ; QSF Assignment ;
; Location ; ; ; GPIO_0[7] ; PIN_J20 ; QSF Assignment ;
; Location ; ; ; GPIO_0[8] ; PIN_F25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[9] ; PIN_F26 ; QSF Assignment ;
; Location ; ; ; GPIO_1[0] ; PIN_K25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[10] ; PIN_N24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[11] ; PIN_P24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[12] ; PIN_R25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[13] ; PIN_R24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[14] ; PIN_R20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[15] ; PIN_T22 ; QSF Assignment ;
; Location ; ; ; GPIO_1[16] ; PIN_T23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[17] ; PIN_T24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[18] ; PIN_T25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[19] ; PIN_T18 ; QSF Assignment ;
; Location ; ; ; GPIO_1[1] ; PIN_K26 ; QSF Assignment ;
; Location ; ; ; GPIO_1[20] ; PIN_T21 ; QSF Assignment ;
; Location ; ; ; GPIO_1[21] ; PIN_T20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[22] ; PIN_U26 ; QSF Assignment ;
; Location ; ; ; GPIO_1[23] ; PIN_U25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[24] ; PIN_U23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[25] ; PIN_U24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[26] ; PIN_R19 ; QSF Assignment ;
; Location ; ; ; GPIO_1[27] ; PIN_T19 ; QSF Assignment ;
; Location ; ; ; GPIO_1[28] ; PIN_U20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[29] ; PIN_U21 ; QSF Assignment ;
; Location ; ; ; GPIO_1[2] ; PIN_M22 ; QSF Assignment ;
; Location ; ; ; GPIO_1[30] ; PIN_V26 ; QSF Assignment ;
; Location ; ; ; GPIO_1[31] ; PIN_V25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[32] ; PIN_V24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[33] ; PIN_V23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[34] ; PIN_W25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[35] ; PIN_W23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[3] ; PIN_M23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[4] ; PIN_M19 ; QSF Assignment ;
; Location ; ; ; GPIO_1[5] ; PIN_M20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[6] ; PIN_N20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[7] ; PIN_M21 ; QSF Assignment ;
; Location ; ; ; GPIO_1[8] ; PIN_M24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[9] ; PIN_M25 ; QSF Assignment ;
; Location ; ; ; HEX4[0] ; PIN_U9 ; QSF Assignment ;
; Location ; ; ; HEX4[1] ; PIN_U1 ; QSF Assignment ;
; Location ; ; ; HEX4[2] ; PIN_U2 ; QSF Assignment ;
; Location ; ; ; HEX4[3] ; PIN_T4 ; QSF Assignment ;
; Location ; ; ; HEX4[4] ; PIN_R7 ; QSF Assignment ;
; Location ; ; ; HEX4[5] ; PIN_R6 ; QSF Assignment ;
; Location ; ; ; HEX4[6] ; PIN_T3 ; QSF Assignment ;
; Location ; ; ; HEX5[0] ; PIN_T2 ; QSF Assignment ;
; Location ; ; ; HEX5[1] ; PIN_P6 ; QSF Assignment ;
; Location ; ; ; HEX5[2] ; PIN_P7 ; QSF Assignment ;
; Location ; ; ; HEX5[3] ; PIN_T9 ; QSF Assignment ;
; Location ; ; ; HEX5[4] ; PIN_R5 ; QSF Assignment ;
; Location ; ; ; HEX5[5] ; PIN_R4 ; QSF Assignment ;
; Location ; ; ; HEX5[6] ; PIN_R3 ; QSF Assignment ;
; Location ; ; ; HEX6[0] ; PIN_R2 ; QSF Assignment ;
; Location ; ; ; HEX6[1] ; PIN_P4 ; QSF Assignment ;
; Location ; ; ; HEX6[2] ; PIN_P3 ; QSF Assignment ;
; Location ; ; ; HEX6[3] ; PIN_M2 ; QSF Assignment ;
; Location ; ; ; HEX6[4] ; PIN_M3 ; QSF Assignment ;
; Location ; ; ; HEX6[5] ; PIN_M5 ; QSF Assignment ;
; Location ; ; ; HEX6[6] ; PIN_M4 ; QSF Assignment ;
; Location ; ; ; HEX7[0] ; PIN_L3 ; QSF Assignment ;
; Location ; ; ; HEX7[1] ; PIN_L2 ; QSF Assignment ;
; Location ; ; ; HEX7[2] ; PIN_L9 ; QSF Assignment ;
; Location ; ; ; HEX7[3] ; PIN_L6 ; QSF Assignment ;
; Location ; ; ; HEX7[4] ; PIN_L7 ; QSF Assignment ;
; Location ; ; ; HEX7[5] ; PIN_P9 ; QSF Assignment ;
; Location ; ; ; HEX7[6] ; PIN_N9 ; QSF Assignment ;
; Location ; ; ; IRDA_RXD ; PIN_AE25 ; QSF Assignment ;
; Location ; ; ; IRDA_TXD ; PIN_AE24 ; QSF Assignment ;
; Location ; ; ; LCD_BLON ; PIN_K2 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[0] ; PIN_J1 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[1] ; PIN_J2 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[2] ; PIN_H1 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[3] ; PIN_H2 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[4] ; PIN_J4 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[5] ; PIN_J3 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[6] ; PIN_H4 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[7] ; PIN_H3 ; QSF Assignment ;
; Location ; ; ; LCD_EN ; PIN_K3 ; QSF Assignment ;
; Location ; ; ; LCD_ON ; PIN_L4 ; QSF Assignment ;
; Location ; ; ; LCD_RS ; PIN_K1 ; QSF Assignment ;
; Location ; ; ; LCD_RW ; PIN_K4 ; QSF Assignment ;
; Location ; ; ; OTG_ADDR[0] ; PIN_K7 ; QSF Assignment ;
; Location ; ; ; OTG_ADDR[1] ; PIN_F2 ; QSF Assignment ;
; Location ; ; ; OTG_CS_N ; PIN_F1 ; QSF Assignment ;
; Location ; ; ; OTG_DACK0_N ; PIN_C2 ; QSF Assignment ;
; Location ; ; ; OTG_DACK1_N ; PIN_B2 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[0] ; PIN_F4 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[10] ; PIN_K6 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[11] ; PIN_K5 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[12] ; PIN_G4 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[13] ; PIN_G3 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[14] ; PIN_J6 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[15] ; PIN_K8 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[1] ; PIN_D2 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[2] ; PIN_D1 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[3] ; PIN_F7 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[4] ; PIN_J5 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[5] ; PIN_J8 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[6] ; PIN_J7 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[7] ; PIN_H6 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[8] ; PIN_E2 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[9] ; PIN_E1 ; QSF Assignment ;
; Location ; ; ; OTG_DREQ0 ; PIN_F6 ; QSF Assignment ;
; Location ; ; ; OTG_DREQ1 ; PIN_E5 ; QSF Assignment ;
; Location ; ; ; OTG_FSPEED ; PIN_F3 ; QSF Assignment ;
; Location ; ; ; OTG_INT0 ; PIN_B3 ; QSF Assignment ;
; Location ; ; ; OTG_INT1 ; PIN_C3 ; QSF Assignment ;
; Location ; ; ; OTG_LSPEED ; PIN_G6 ; QSF Assignment ;
; Location ; ; ; OTG_RD_N ; PIN_G2 ; QSF Assignment ;
; Location ; ; ; OTG_RST_N ; PIN_G5 ; QSF Assignment ;
; Location ; ; ; OTG_WR_N ; PIN_G1 ; QSF Assignment ;
; Location ; ; ; PS2_CLK ; PIN_D26 ; QSF Assignment ;
; Location ; ; ; PS2_DAT ; PIN_C24 ; QSF Assignment ;
; Location ; ; ; SD_CLK ; PIN_AD25 ; QSF Assignment ;
; Location ; ; ; SD_CMD ; PIN_Y21 ; QSF Assignment ;
; Location ; ; ; SD_DAT ; PIN_AD24 ; QSF Assignment ;
; Location ; ; ; SD_DAT3 ; PIN_AC23 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[0] ; PIN_AE4 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[10] ; PIN_V10 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[11] ; PIN_V9 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[12] ; PIN_AC7 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[13] ; PIN_W8 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[14] ; PIN_W10 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[15] ; PIN_Y10 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[16] ; PIN_AB8 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[17] ; PIN_AC8 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[1] ; PIN_AF4 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[2] ; PIN_AC5 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[3] ; PIN_AC6 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[4] ; PIN_AD4 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[5] ; PIN_AD5 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[6] ; PIN_AE5 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[7] ; PIN_AF5 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[8] ; PIN_AD6 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[9] ; PIN_AD7 ; QSF Assignment ;
; Location ; ; ; SRAM_CE_N ; PIN_AC11 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[0] ; PIN_AD8 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[10] ; PIN_AE8 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[11] ; PIN_AF8 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[12] ; PIN_W11 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[13] ; PIN_W12 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[14] ; PIN_AC9 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[15] ; PIN_AC10 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[1] ; PIN_AE6 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[2] ; PIN_AF6 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[3] ; PIN_AA9 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[4] ; PIN_AA10 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[5] ; PIN_AB10 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[6] ; PIN_AA11 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[7] ; PIN_Y11 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[8] ; PIN_AE7 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[9] ; PIN_AF7 ; QSF Assignment ;
; Location ; ; ; SRAM_LB_N ; PIN_AE9 ; QSF Assignment ;
; Location ; ; ; SRAM_OE_N ; PIN_AD10 ; QSF Assignment ;
; Location ; ; ; SRAM_UB_N ; PIN_AF9 ; QSF Assignment ;
; Location ; ; ; SRAM_WE_N ; PIN_AE10 ; QSF Assignment ;
; Location ; ; ; TCK ; PIN_D14 ; QSF Assignment ;
; Location ; ; ; TCS ; PIN_A14 ; QSF Assignment ;
; Location ; ; ; TDI ; PIN_B14 ; QSF Assignment ;
; Location ; ; ; TDO ; PIN_F14 ; QSF Assignment ;
; Location ; ; ; TD_DATA[0] ; PIN_J9 ; QSF Assignment ;
; Location ; ; ; TD_DATA[1] ; PIN_E8 ; QSF Assignment ;
; Location ; ; ; TD_DATA[2] ; PIN_H8 ; QSF Assignment ;
; Location ; ; ; TD_DATA[3] ; PIN_H10 ; QSF Assignment ;
; Location ; ; ; TD_DATA[4] ; PIN_G9 ; QSF Assignment ;
; Location ; ; ; TD_DATA[5] ; PIN_F9 ; QSF Assignment ;
; Location ; ; ; TD_DATA[6] ; PIN_D7 ; QSF Assignment ;
; Location ; ; ; TD_DATA[7] ; PIN_C7 ; QSF Assignment ;
; Location ; ; ; TD_HS ; PIN_D5 ; QSF Assignment ;
; Location ; ; ; TD_RESET ; PIN_C4 ; QSF Assignment ;
; Location ; ; ; TD_VS ; PIN_K9 ; QSF Assignment ;
; Location ; ; ; UART_RXD ; PIN_C25 ; QSF Assignment ;
; Location ; ; ; UART_TXD ; PIN_B25 ; QSF Assignment ;
; Fast Input Register ; sdram ; ; za_data[0]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[10]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[11]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[12]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[13]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[14]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[15]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[1]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[2]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[3]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[4]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[5]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[6]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[7]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[8]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Input Register ; sdram ; ; za_data[9]~reg0 ; ON ; Compiler or HDL Assignment ;
; Fast Output Register ; sdram ; ; m_dqm[0] ; ON ; Compiler or HDL Assignment ;
; Fast Output Register ; sdram ; ; m_dqm[1] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[0] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[10] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[11] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[12] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[13] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[14] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[15] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[1] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[2] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[3] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[4] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[5] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[6] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[7] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[8] ; ON ; Compiler or HDL Assignment ;
; Fast Output Enable Register ; sdram ; ; m_data[9] ; ON ; Compiler or HDL Assignment ;
+-----------------------------+----------------+--------------+------------------+---------------+----------------------------+
+----------------------------------------------+
; Incremental Compilation Preservation Summary ;
+---------------------+------------------------+
; Type ; Value ;
+---------------------+------------------------+
; Placement (by node) ; ;
; -- Requested ; 0 / 3840 ( 0.00 % ) ;
; -- Achieved ; 0 / 3840 ( 0.00 % ) ;
; ; ;
; Routing (by net) ; ;
; -- Requested ; 0 / 0 ( 0.00 % ) ;
; -- Achieved ; 0 / 0 ( 0.00 % ) ;
+---------------------+------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Incremental Compilation Partition Settings ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
; Partition Name ; Partition Type ; Netlist Type Used ; Preservation Level Used ; Netlist Type Requested ; Preservation Level Requested ; Contents ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
; Top ; User-created ; Source File ; N/A ; Source File ; N/A ; ;
; hard_block:auto_generated_inst ; Auto-generated ; Source File ; N/A ; Source File ; N/A ; hard_block:auto_generated_inst ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
+------------------------------------------------------------------------------------------------------------+
; Incremental Compilation Placement Preservation ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
; Partition Name ; # Nodes ; # Preserved Nodes ; Preservation Level Used ; Netlist Type Used ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
; Top ; 3833 ; 0 ; N/A ; Source File ;
; hard_block:auto_generated_inst ; 7 ; 0 ; N/A ; Source File ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in /home/nelson/Downloads/voice_recorder_demo/vr.pin.
+--------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+----------------------------+
; Resource ; Usage ;
+---------------------------------------------+----------------------------+
; Total logic elements ; 2,482 / 33,216 ( 7 % ) ;
; -- Combinational with no register ; 1269 ;
; -- Register only ; 121 ;
; -- Combinational with a register ; 1092 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 901 ;
; -- 3 input functions ; 978 ;
; -- <=2 input functions ; 482 ;
; -- Register only ; 121 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 1362 ;
; -- arithmetic mode ; 999 ;
; ; ;
; Total registers* ; 1,279 / 34,593 ( 4 % ) ;
; -- Dedicated logic registers ; 1,213 / 33,216 ( 4 % ) ;
; -- I/O registers ; 66 / 1,377 ( 5 % ) ;
; ; ;
; Total LABs: partially or completely used ; 186 / 2,076 ( 9 % ) ;
; Virtual pins ; 0 ;
; I/O pins ; 159 / 475 ( 33 % ) ;
; -- Clock pins ; 8 / 8 ( 100 % ) ;
; ; ;
; Global signals ; 3 ;
; M4Ks ; 22 / 105 ( 21 % ) ;
; Total block memory bits ; 87,040 / 483,840 ( 18 % ) ;
; Total block memory implementation bits ; 101,376 / 483,840 ( 21 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; PLLs ; 1 / 4 ( 25 % ) ;
; Global clocks ; 3 / 16 ( 19 % ) ;
; JTAGs ; 0 / 1 ( 0 % ) ;
; ASMI blocks ; 0 / 1 ( 0 % ) ;
; CRC blocks ; 0 / 1 ( 0 % ) ;
; Average interconnect usage (total/H/V) ; 3% / 3% / 2% ;
; Peak interconnect usage (total/H/V) ; 17% / 16% / 19% ;
; Maximum fan-out ; 1249 ;
; Highest non-global fan-out ; 452 ;
; Total fan-out ; 11356 ;
; Average fan-out ; 2.94 ;
+---------------------------------------------+----------------------------+
* Register count does not include registers inside RAM blocks or DSP blocks.
+-----------------------------------------------------------------------------------------------------+
; Fitter Partition Statistics ;
+---------------------------------------------+----------------------+--------------------------------+
; Statistic ; Top ; hard_block:auto_generated_inst ;
+---------------------------------------------+----------------------+--------------------------------+
; Difficulty Clustering Region ; Low ; Low ;
; ; ; ;
; Total logic elements ; 2482 / 33216 ( 7 % ) ; 0 / 33216 ( 0 % ) ;
; -- Combinational with no register ; 1269 ; 0 ;
; -- Register only ; 121 ; 0 ;
; -- Combinational with a register ; 1092 ; 0 ;
; ; ; ;
; Logic element usage by number of LUT inputs ; ; ;
; -- 4 input functions ; 901 ; 0 ;
; -- 3 input functions ; 978 ; 0 ;
; -- <=2 input functions ; 482 ; 0 ;
; -- Register only ; 121 ; 0 ;
; ; ; ;
; Logic elements by mode ; ; ;
; -- normal mode ; 1362 ; 0 ;
; -- arithmetic mode ; 999 ; 0 ;
; ; ; ;
; Total registers ; 1279 ; 0 ;
; -- Dedicated logic registers ; 1213 / 33216 ( 4 % ) ; 0 / 33216 ( 0 % ) ;
; -- I/O registers ; 66 ; 0 ;
; ; ; ;
; Total LABs: partially or completely used ; 186 / 2076 ( 9 % ) ; 0 / 2076 ( 0 % ) ;
; ; ; ;
; Virtual pins ; 0 ; 0 ;
; I/O pins ; 159 ; 0 ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ; 0 / 70 ( 0 % ) ;
; Total memory bits ; 87040 ; 0 ;
; Total RAM block bits ; 101376 ; 0 ;
; PLL ; 0 / 4 ( 0 % ) ; 1 / 4 ( 25 % ) ;
; M4K ; 22 / 105 ( 20 % ) ; 0 / 105 ( 0 % ) ;
; Clock control block ; 1 / 20 ( 5 % ) ; 3 / 20 ( 15 % ) ;
; ; ; ;
; Connections ; ; ;
; -- Input Connections ; 58 ; 1 ;
; -- Registered Input Connections ; 55 ; 0 ;
; -- Output Connections ; 1 ; 58 ;
; -- Registered Output Connections ; 0 ; 0 ;
; ; ; ;
; Internal Connections ; ; ;
; -- Total Connections ; 11779 ; 62 ;
; -- Registered Connections ; 3246 ; 0 ;
; ; ; ;
; External Connections ; ; ;
; -- Top ; 0 ; 59 ;
; -- hard_block:auto_generated_inst ; 59 ; 0 ;
; ; ; ;
; Partition Interface ; ; ;
; -- Input Ports ; 24 ; 1 ;
; -- Output Ports ; 115 ; 3 ;
; -- Bidir Ports ; 20 ; 0 ;
; ; ; ;
; Registered Ports ; ; ;
; -- Registered Input Ports ; 0 ; 0 ;
; -- Registered Output Ports ; 0 ; 0 ;
; ; ; ;
; Port Connectivity ; ; ;
; -- Input Ports driven by GND ; 0 ; 0 ;
; -- Output Ports driven by GND ; 0 ; 0 ;
; -- Input Ports driven by VCC ; 0 ; 0 ;
; -- Output Ports driven by VCC ; 0 ; 0 ;
; -- Input Ports with no Source ; 0 ; 0 ;
; -- Output Ports with no Source ; 0 ; 0 ;
; -- Input Ports with no Fanout ; 0 ; 0 ;
; -- Output Ports with no Fanout ; 0 ; 0 ;
+---------------------------------------------+----------------------+--------------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; AUD_ADCDAT ; B5 ; 3 ; 3 ; 36 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; CLOCK_50 ; N2 ; 2 ; 0 ; 18 ; 0 ; 2 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; KEY[0] ; G26 ; 5 ; 65 ; 27 ; 1 ; 452 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; KEY[1] ; N23 ; 5 ; 65 ; 20 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; KEY[2] ; P23 ; 6 ; 65 ; 18 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; KEY[3] ; W26 ; 6 ; 65 ; 10 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[0] ; N25 ; 5 ; 65 ; 19 ; 0 ; 28 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[10] ; N1 ; 2 ; 0 ; 18 ; 1 ; 40 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[11] ; P1 ; 1 ; 0 ; 18 ; 3 ; 16 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[12] ; P2 ; 1 ; 0 ; 18 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[13] ; T7 ; 1 ; 0 ; 11 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[14] ; U3 ; 1 ; 0 ; 12 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[15] ; U4 ; 1 ; 0 ; 12 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[16] ; V1 ; 1 ; 0 ; 12 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[17] ; V2 ; 1 ; 0 ; 12 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[1] ; N26 ; 5 ; 65 ; 19 ; 1 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[2] ; P25 ; 6 ; 65 ; 19 ; 2 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[3] ; AE14 ; 7 ; 33 ; 0 ; 0 ; 5 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[4] ; AF14 ; 7 ; 33 ; 0 ; 1 ; 5 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[5] ; AD13 ; 8 ; 33 ; 0 ; 2 ; 30 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[6] ; AC13 ; 8 ; 33 ; 0 ; 3 ; 33 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[7] ; C13 ; 3 ; 31 ; 36 ; 2 ; 33 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[8] ; B13 ; 4 ; 31 ; 36 ; 0 ; 33 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; SW[9] ; A13 ; 4 ; 31 ; 36 ; 1 ; 40 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------+---------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ; Output Enable Source ; Output Enable Group ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------+---------------------+
; AUD_DACDAT ; A4 ; 3 ; 1 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; AUD_XCK ; A5 ; 3 ; 3 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[0] ; T6 ; 1 ; 0 ; 11 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[10] ; Y1 ; 1 ; 0 ; 9 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[11] ; V5 ; 1 ; 0 ; 8 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[1] ; V4 ; 1 ; 0 ; 11 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[2] ; V3 ; 1 ; 0 ; 11 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[3] ; W2 ; 1 ; 0 ; 10 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[4] ; W1 ; 1 ; 0 ; 10 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[5] ; U6 ; 1 ; 0 ; 10 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[6] ; U7 ; 1 ; 0 ; 10 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[7] ; U5 ; 1 ; 0 ; 9 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[8] ; W4 ; 1 ; 0 ; 9 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_ADDR[9] ; W3 ; 1 ; 0 ; 9 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_BA_0 ; AE2 ; 1 ; 0 ; 3 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_BA_1 ; AE3 ; 1 ; 0 ; 3 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_CAS_N ; AB3 ; 1 ; 0 ; 3 ; 2 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_CKE ; AA6 ; 1 ; 0 ; 2 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_CLK ; AA7 ; 1 ; 0 ; 2 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_CS_N ; AC3 ; 1 ; 0 ; 2 ; 0 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_LDQM ; AD2 ; 1 ; 0 ; 4 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_RAS_N ; AB4 ; 1 ; 0 ; 3 ; 3 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_UDQM ; Y5 ; 1 ; 0 ; 4 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_WE_N ; AD3 ; 1 ; 0 ; 4 ; 3 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[0] ; AF10 ; 8 ; 24 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[1] ; AB12 ; 8 ; 24 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[2] ; AC12 ; 8 ; 24 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[3] ; AD11 ; 8 ; 27 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[4] ; AE11 ; 8 ; 27 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[5] ; V14 ; 8 ; 27 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[6] ; V13 ; 8 ; 27 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[0] ; V20 ; 6 ; 65 ; 3 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[1] ; V21 ; 6 ; 65 ; 3 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[2] ; W21 ; 6 ; 65 ; 4 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[3] ; Y22 ; 6 ; 65 ; 4 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[4] ; AA24 ; 6 ; 65 ; 4 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[5] ; AA23 ; 6 ; 65 ; 5 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[6] ; AB24 ; 6 ; 65 ; 5 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX2[0] ; AB23 ; 6 ; 65 ; 5 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX2[1] ; V22 ; 6 ; 65 ; 6 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX2[2] ; AC25 ; 6 ; 65 ; 6 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX2[3] ; AC26 ; 6 ; 65 ; 6 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX2[4] ; AB26 ; 6 ; 65 ; 7 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX2[5] ; AB25 ; 6 ; 65 ; 7 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX2[6] ; Y24 ; 6 ; 65 ; 7 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX3[0] ; Y23 ; 6 ; 65 ; 7 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX3[1] ; AA25 ; 6 ; 65 ; 8 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX3[2] ; AA26 ; 6 ; 65 ; 8 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX3[3] ; Y26 ; 6 ; 65 ; 8 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX3[4] ; Y25 ; 6 ; 65 ; 8 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX3[5] ; U22 ; 6 ; 65 ; 9 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX3[6] ; W24 ; 6 ; 65 ; 9 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; I2C_SCLK ; A6 ; 3 ; 3 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDG[0] ; AE22 ; 7 ; 59 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDG[1] ; AF22 ; 7 ; 59 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDG[2] ; W19 ; 7 ; 59 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDG[3] ; V18 ; 7 ; 59 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDG[4] ; U18 ; 7 ; 57 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDG[5] ; U17 ; 7 ; 57 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDG[6] ; AA20 ; 7 ; 57 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDG[7] ; Y18 ; 7 ; 57 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDG[8] ; Y12 ; 8 ; 29 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[0] ; AE23 ; 7 ; 63 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[10] ; AA13 ; 7 ; 35 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[11] ; AC14 ; 7 ; 35 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[12] ; AD15 ; 7 ; 35 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[13] ; AE15 ; 7 ; 35 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[14] ; AF13 ; 8 ; 31 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[15] ; AE13 ; 8 ; 31 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[16] ; AE12 ; 8 ; 31 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[17] ; AD12 ; 8 ; 31 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[1] ; AF23 ; 7 ; 63 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[2] ; AB21 ; 7 ; 63 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[3] ; AC22 ; 7 ; 63 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[4] ; AD22 ; 7 ; 61 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[5] ; AD23 ; 7 ; 61 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[6] ; AD21 ; 7 ; 61 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[7] ; AC21 ; 7 ; 61 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[8] ; AA14 ; 7 ; 37 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDR[9] ; Y13 ; 7 ; 37 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_BLANK ; D6 ; 3 ; 11 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[0] ; J13 ; 3 ; 24 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[1] ; J14 ; 3 ; 24 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[2] ; F12 ; 3 ; 27 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[3] ; G12 ; 3 ; 27 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[4] ; J10 ; 3 ; 27 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[5] ; J11 ; 3 ; 27 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[6] ; C11 ; 3 ; 29 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[7] ; B11 ; 3 ; 29 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[8] ; C12 ; 3 ; 29 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_B[9] ; B12 ; 3 ; 29 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_CLK ; B8 ; 3 ; 16 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[0] ; B9 ; 3 ; 20 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[1] ; A9 ; 3 ; 20 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[2] ; C10 ; 3 ; 20 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[3] ; D10 ; 3 ; 20 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[4] ; B10 ; 3 ; 22 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[5] ; A10 ; 3 ; 22 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[6] ; G11 ; 3 ; 22 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[7] ; D11 ; 3 ; 22 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[8] ; E12 ; 3 ; 24 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_G[9] ; D12 ; 3 ; 24 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_HS ; A7 ; 3 ; 11 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[0] ; C8 ; 3 ; 14 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[1] ; F10 ; 3 ; 14 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[2] ; G10 ; 3 ; 14 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[3] ; D9 ; 3 ; 16 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[4] ; C9 ; 3 ; 16 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[5] ; A8 ; 3 ; 16 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[6] ; H11 ; 3 ; 18 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[7] ; H12 ; 3 ; 18 ; 36 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[8] ; F11 ; 3 ; 18 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_R[9] ; E10 ; 3 ; 18 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_SYNC ; B7 ; 3 ; 11 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; VGA_VS ; D8 ; 3 ; 14 ; 36 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
+---------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------+---------------------+
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; Bidir Pins ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------------------------------------------------------------------------------------------------+---------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ; Output Enable Source ; Output Enable Group ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------------------------------------------------------------------------------------------------+---------------------+
; AUD_ADCLRCK ; C5 ; 3 ; 1 ; 36 ; 3 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; AUD_BCLK ; B4 ; 3 ; 1 ; 36 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; AUD_DACLRCK ; C6 ; 3 ; 1 ; 36 ; 2 ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; DRAM_DQ[0] ; V6 ; 1 ; 0 ; 8 ; 1 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[10] ; AB1 ; 1 ; 0 ; 6 ; 3 ; 0 ; 4 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[11] ; AA4 ; 1 ; 0 ; 5 ; 0 ; 0 ; 5 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[12] ; AA3 ; 1 ; 0 ; 5 ; 1 ; 0 ; 5 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[13] ; AC2 ; 1 ; 0 ; 5 ; 2 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[14] ; AC1 ; 1 ; 0 ; 5 ; 3 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[15] ; AA5 ; 1 ; 0 ; 4 ; 0 ; 0 ; 7 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[1] ; AA2 ; 1 ; 0 ; 8 ; 2 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[2] ; AA1 ; 1 ; 0 ; 8 ; 3 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[3] ; Y3 ; 1 ; 0 ; 7 ; 0 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[4] ; Y4 ; 1 ; 0 ; 7 ; 1 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[5] ; R8 ; 1 ; 0 ; 7 ; 2 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[6] ; T8 ; 1 ; 0 ; 7 ; 3 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[7] ; V7 ; 1 ; 0 ; 6 ; 0 ; 0 ; 4 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[8] ; W6 ; 1 ; 0 ; 6 ; 1 ; 0 ; 4 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; DRAM_DQ[9] ; AB2 ; 1 ; 0 ; 6 ; 2 ; 0 ; 3 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; sdram:ram|always5~0 ; - ;
; I2C_SDAT ; B6 ; 3 ; 3 ; 36 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; Audio_Controller:Audio_Controller|Audio_and_Video_Config:Audio_Config|Altera_UP_I2C:I2C_Controller|i2c_sdata~3 ; - ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------------------------------------------------------------------------------------------------+---------------------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 45 / 64 ( 70 % ) ; 3.3V ; -- ;
; 2 ; 4 / 59 ( 7 % ) ; 3.3V ; -- ;
; 3 ; 44 / 56 ( 79 % ) ; 3.3V ; -- ;
; 4 ; 2 / 58 ( 3 % ) ; 3.3V ; -- ;
; 5 ; 4 / 65 ( 6 % ) ; 3.3V ; -- ;
; 6 ; 25 / 59 ( 42 % ) ; 3.3V ; -- ;
; 7 ; 24 / 58 ( 41 % ) ; 3.3V ; -- ;
; 8 ; 14 / 56 ( 25 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; A2 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A3 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A4 ; 484 ; 3 ; AUD_DACDAT ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A5 ; 482 ; 3 ; AUD_XCK ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A6 ; 479 ; 3 ; I2C_SCLK ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A7 ; 465 ; 3 ; VGA_HS ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A8 ; 457 ; 3 ; VGA_R[5] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A9 ; 451 ; 3 ; VGA_G[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A10 ; 447 ; 3 ; VGA_G[5] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A11 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A12 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A13 ; 430 ; 4 ; SW[9] ; input ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; A14 ; 427 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A15 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; A16 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A17 ; 412 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A18 ; 406 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A19 ; 394 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A20 ; 390 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A21 ; 382 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A22 ; 379 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A23 ; 378 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; A24 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; A25 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; AA1 ; 107 ; 1 ; DRAM_DQ[2] ; bidir ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA2 ; 106 ; 1 ; DRAM_DQ[1] ; bidir ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA3 ; 117 ; 1 ; DRAM_DQ[12] ; bidir ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA4 ; 116 ; 1 ; DRAM_DQ[11] ; bidir ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA5 ; 120 ; 1 ; DRAM_DQ[15] ; bidir ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA6 ; 130 ; 1 ; DRAM_CKE ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA7 ; 129 ; 1 ; DRAM_CLK ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA8 ; ; ; VCCA_PLL1 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; AA9 ; 152 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA10 ; 153 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA11 ; 155 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA12 ; 179 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA13 ; 192 ; 7 ; LEDR[10] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; AA14 ; 194 ; 7 ; LEDR[8] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; AA15 ; 197 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA16 ; 209 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA17 ; 219 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA18 ; 220 ; 7 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; AA19 ; ; ; VCCA_PLL4 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; AA20 ; 230 ; 7 ; LEDG[6] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; AA21 ; ; ; GND_PLL4 ; gnd ; ; ; -- ; ; -- ; -- ;
; AA22 ; ; 6 ; VCCIO6 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; AA23 ; 256 ; 6 ; HEX1[5] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA24 ; 255 ; 6 ; HEX1[4] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA25 ; 266 ; 6 ; HEX3[1] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AA26 ; 267 ; 6 ; HEX3[2] ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AB1 ; 115 ; 1 ; DRAM_DQ[10] ; bidir ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AB2 ; 114 ; 1 ; DRAM_DQ[9] ; bidir ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AB3 ; 126 ; 1 ; DRAM_CAS_N ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AB4 ; 127 ; 1 ; DRAM_RAS_N ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; AB5 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; AB6 ; ; 8 ; VCCIO8 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; AB7 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; AB8 ; 147 ; 8 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;