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/*
* Registers for the Lynx 10G SerDes block.
*
* Must be included by an SoC-specific header that defines the
* SRDS_BASE value.
*/
#define PLLnRSTCTL(n) (SRDS_BASE + (0x20 * (n)))
#define PLLnCR0(n) (SRDS_BASE + (0x20 * (n)) + 0x0004)
#define POFF(x) (((x) << 31) & 0x80000000)
#define REFCLK_SEL(x) (((x) << 28) & 0x70000000)
#define REFCLK_EN(x) (((x) << 27) & 0x08000000)
#define FRATE_SEL(x) (((x) << 16) & 0x000f0000)
#define DLYDIV_SEL(x) ((x) & 0x00000003)
#define PCCR8 (SRDS_BASE + 0x0220)
#define SGMIIA_KX(x) (((x) << 31) & 0x80000000)
#define SGMIIA_CFG(x) (((x) << 28) & 0x70000000)
#define SGMIIB_KX(x) (((x) << 27) & 0x08000000)
#define SGMIIB_CFG(x) (((x) << 24) & 0x07000000)
#define SGMIIC_KX(x) (((x) << 23) & 0x00800000)
#define SGMIIC_CFG(x) (((x) << 20) & 0x00700000)
#define SGMIID_KX(x) (((x) << 19) & 0x00080000)
#define SGMIID_CFG(x) (((x) << 16) & 0x00070000)
#define SGMIIE_KX(x) (((x) << 15) & 0x00008000)
#define SGMIIE_CFG(x) (((x) << 12) & 0x00007000)
#define SGMIIF_KX(x) (((x) << 11) & 0x00000800)
#define SGMIIF_CFG(x) (((x) << 8) & 0x00000700)
#define SGMIIG_KX(x) (((x) << 7) & 0x00000080)
#define SGMIIG_CFG(x) (((x) << 4) & 0x00000070)
#define SGMIIH_KX(x) (((x) << 3) & 0x00000008)
#define SGMIIH_CFG(x) ((x) & 0x00000007)
#define PCCRB (SRDS_BASE + 0x022c)
#define XFIA_CFG(x) (((x) << 28) & 0x70000000)
#define XFIB_CFG(x) (((x) << 24) & 0x07000000)
#define XFIC_CFG(x) (((x) << 20) & 0x00700000)
#define XFID_CFG(x) (((x) << 16) & 0x00070000)
#define XFIE_CFG(x) (((x) << 12) & 0x00007000)
#define XFIF_CFG(x) (((x) << 8) & 0x00000700)
#define XFIG_CFG(x) (((x) << 4) & 0x00000070)
#define XFIH_CFG(x) ((x) & 0x00000007)
#define LNmGCR0(m) (SRDS_BASE + (0x40 * (m)) + 0x0800)
#define RPLL_LES(x) (((x) << 31) & 0x80000000)
#define RRAT_SEL(x) (((x) << 28) & 0x30000000)
#define TPLL_LES(x) (((x) << 27) & 0x08000000)
#define TRAT_SEL(x) (((x) << 24) & 0x03000000)
#define RRST_B(x) (((x) << 22) & 0x00400000)
#define TRST_B(x) (((x) << 21) & 0x00200000)
#define RX_PD(x) (((x) << 20) & 0x00100000)
#define TX_PD(x) (((x) << 19) & 0x00080000)
#define IF20BIT_EN(x) (((x) << 18) & 0x00040000)
#define FIRST_LANE(x) (((x) << 16) & 0x00010000)
#define GCR0_RSV 0x1000
#define PROTS(x) (((x) << 7) & 0x00000f80)
#define LNmGCR1(m) (SRDS_BASE + (0x40 * (m)) + 0x0804)
#define RDAT_INV(x) (((x) << 31) & 0x80000000)
#define TDAT_INV(x) (((x) << 30) & 0x40000000)
#define OPAD_CTL(x) (((x) << 26) & 0x04000000)
#define REIDL_TH(x) (((x) << 20) & 0x00700000)
#define REIDL_EX_SEL(x) (((x) << 18) & 0x000C0000)
#define REIDL_ET_SEL(x) (((x) << 16) & 0x00030000)
#define REIDL_EX_MSB(x) (((x) << 15) & 0x00008000)
#define REIDL_ET_MSB(x) (((x) << 14) & 0x00004000)
#define REQ_CTL_SNP(x) (((x) << 13) & 0x00002000)
#define REQ_CDR_SNP(x) (((x) << 12) & 0x00001000)
#define TRSTDIR(x) (((x) << 7) & 0x00000080)
#define REQ_BIN_SNP(x) (((x) << 6) & 0x00000040)
#define ISLEW_RCTL(x) (((x) << 4) & 0x00000030)
#define GCR1_RSV 0x8
#define OSLEW_RCTL(x) ((x) & 0x3)
#define LNmRECR0(m) (SRDS_BASE + (0x40 * (m)) + 0x0810)
#define RXEQ_BST(x) (((x) << 28) & 0x10000000)
#define GK2OVD(x) (((x) << 24) & 0x0f000000)
#define GK3OVD(x) (((x) << 16) & 0x000f0000)
#define GK2OVD_EN(x) (((x) << 15) & 0x00008000)
#define GK3OVD_EN(x) (((x) << 14) & 0x00004000)
#define OSETOVD_EN(x) (((x) << 13) & 0x00002000)
#define BASE_WAND(x) (((x) << 10) & 0x00000c00)
#define OSETOVD(x) ((x) & 0x0000007F)
#define LNmTECR0(m) (SRDS_BASE + (0x40 * (m)) + 0x0818)
#define TEQ_TYPE(x) (((x) << 28) & 0x30000000)
#define SGN_PREQ(x) (((x) << 26) & 0x04000000)
#define RATIO_PREQ(x) (((x) << 22) & 0x03C00000)
#define SGN_POST1Q(x) (((x) << 21) & 0x00200000)
#define RATIO_PST1Q(x) (((x) << 16) & 0x001F0000)
#define ADPT_EQ(x) (((x) << 8) & 0x00003F00)
#define AMP_RED(x) ((x) & 0x0000003f)
#define LNmSSCR1(m) (SRDS_BASE + (0x40 * (m)) + 0x081c)
#define LNmTTLCR0(m) (SRDS_BASE + (0x40 * (m)) + 0x0820)
#define LNmTCSR0(m) (SRDS_BASE + (0x40 * (m)) + 0x0830)
#define LNmTCSR1(m) (SRDS_BASE + (0x40 * (m)) + 0x0834)
#define LNmTCSR2(m) (SRDS_BASE + (0x40 * (m)) + 0x0838)
#define LNmTCSR3(m) (SRDS_BASE + (0x40 * (m)) + 0x083c)
#define SATAaCR0(a) (SRDS_BASE + (0x10 * (a)) + 0x1300)
#define SGMIIaCR0(a) (SRDS_BASE + (0x10 * (a)) + 0x1800)
#define RST_SGM(x) (((x) << 31) & 0x80000000)
#define PD_SGM(x) (((x) << 30) & 0x40000000)
#define SGMIIaCR1(a) (SRDS_BASE + (0x10 * (a)) + 0x1804)
#define SGMII_MDEV_PORT(x) (((x) << 27) & 0xf8000000)
#define SGPCS_EN(x) (((x) << 11) & 0x00000800)
#define XFIaCR0(a) (SRDS_BASE + (0x10 * (a)) + 0x1980)
#define RST_XFI(x) (((x) << 31) & 0x80000000)
#define PD_XFI(x) (((x) << 30) & 0x40000000)
#define XFIaCR1(a) (SRDS_BASE + (0x10 * (a)) + 0x1984)
#define XFI_MDEV_PORT(x) (((x) << 27) & 0xf8000000)